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基于DSP和FPGA的ARINC429機載總線接口板的硬件設計
摘要：介紹了民用飛機機載數據總線ARINC429的硬件接口板，該接口板采用DSP和FPGA實現四種ARINC429信號收發通道，使整個系統的處理速度大大提高。機載數據總線ARINC429在當代的運輸機和相當數量的民航客機（如A310、A300、A600、B757、B767）中有著廣泛的應用。目前國內對ARINC429總線接口板的設計一般都是基于HARRIS公司的HS3282芯片完成的，它的缺點是路數有限、非常不靈活。因此對ARINC429總線接口板的研制，實現多通道ARINC429總線數據的接收和發送，成為目前對飛機載總線接口研究的重點，具有非常重要的現實意義和應用前景。
1 ARINC429總線簡介
在現代民用飛機上，系統與系統之間、系統與部件之間需要傳輸大量信息。ARINC規范就是為了在航空電子設備之間傳輸數字數據信息而制定的一個航空運輸的工業標準。
ARINC429（以下簡稱429）總線采用雙絞屏蔽線傳輸信息，通過一對雙絞線反相傳輸，具有很強的抗干擾能力。而調制方式則采用雙極歸零制的三態碼方式，即信息由“高”、“零”和“低”狀態組成的三電平狀態調制。429電纜上的信號及經電平轉換后的信號如圖1所示。429總線每一個字為32位，它的字同步是以傳輸周期至少4位的時間間隔也就是4位碼字為基準的。
2 系統總體方案
429總線接口板的主要功能是在429信號及相關外設之間起到橋梁作用，它既能接收雙極歸零制的429信號并將其轉換為數字信號送入計算機或其它設備，又可將計算機或其它設備發出的數字信號轉換為429信號輸出。本文介紹的總線接口板采用FPGA和DSP實現四路429信號接收通道和四路429信號發送通道，且每路通道之間相互獨立。在這個接口板中，每兩個數據字之間的時間間隔可調，每一個收發通道能單獨定義字間隔長度，每個通道校驗方式可單獨定義為奇校驗或偶校驗，數據發送可以選擇單幀發送或自動自復發送（重復發送某一幀）。
整個接口板由調制電路、解調電路、FPGA、DSP和雙口RAM組成，如圖2所示。
3 硬件電路設計
3.1 調制解調電路設計
429信號進入接口板后，首先要把429信號轉換為數字電路可以識別的TTL電平。這里采用HOLT公司的HI-8482實現信號的解調，將標準的429總線信號轉換成5V TTL數字信號。為了降低干擾，在429總線信號的四個輸入管腳分別接入39pF高精度軍品電容；采用HOLT公司的HI-8585芯片實現信號的調制，將TTL數字電平轉換為標準的429信號。
3.2 FPGA內部邏輯設計
按照429信號的編碼格式、特點、傳輸規則以及協議要求，選用一片ALTERA公司的ACEX1K型的FPGA發送和接收四路數據。每一路分為接收部分和發送部分。
圖3
接收部分的主要作用是通過串/并轉換將串行數據轉換為32位并行數據，并對收到的數據自動實時差錯控制。對于字間隔、位間隔出錯等錯誤能進行自動檢測，若無錯誤，則將數據分兩次送至DSP的16位數據總線上，以供讀取。接收模塊結構框圖如圖3所示。
發送送的主要功能是將DSP送入的數據暫存在FPGA內部的FIFO中，等待發送命令。一旦接收發送控制指令，FIFO輸出數據并通過并/串轉換將并行數據轉換為串行數據，同時加入預先設定的間隔。用戶可通過寫控制寄存器選擇發送模式（即單幀發送或自動重復發送）、發送通道延遲設定、發送通道字間隔設定，還可通過讀取狀態位檢查它的工作狀態（發送緩沖器空、發送緩沖器滿和是否正在發送）。發送模塊結構框圖如圖4所示。
以上介紹的只是一路發送通道和接收通道，由于本系統共有四種獨立的發送通道和四路獨立的接收通道，故在FPGA中需設置四個接收模塊和四個發送模塊，通過DSP的地址線來選取其中的一路發送通道或接收通道。
FPGA內部結構是基于SRAM的，因此需要一片配置芯片固化內部邏輯。為了便于調試，采用JTAG模式和被動串行模式（PS）兩種配置模式，調試時使用JTAG模式直接將邏輯寫入FPGA內部，調試好后再用PS模式將程序寫入配置芯片。通過對FPGA和配置芯片上的引腳進行跳線，可選擇不同的配置方式。跳線電路如圖5所示。
FPGA作為DSP的一個I/O外設，必須要對它的寄存器地址統一編址。在此將FPGA編址在DSP的I/O空間。由于FPGA的接收通道和發送通道的數據寄存器可以占用一個地址。
3.3 DSP與FPGA及外部設置的通信
在整個系統的設計中，DSP主要用于控制FPGA工作、數據中轉、與外設主機通信。DSP是整個系統的中樞，控制各個部分協調工作。利用DSP向FPGA寫控制字，其中包含幀間隔長度大小等信息，可對FPGA進行控制；另外，根據FPGA的反饋狀態，可倒入出相應的控制調整�？紤]到用于控制FPGA的I/O口比較多，選用的DSP是TI公司的TMSLF2407A。TMSLF2407A的復用外圍I/O口多達39個，圖6是DSP與FPGA之間的具體連接。
DSP提供I/
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